1 3節 邏輯門與二進位制數 part1

2021-06-18 16:25:10 字數 1176 閱讀 1934

好了,看過上面一節的內容,讓我們繼續來搭積木吧~這回我們有了mos作為積木,我們想搭個什麼東西呢?答案是,什麼都行只要有創意。主要是學習」搭積木「的思想,看過本系列一定會知道那是什麼東東。那麼作為啟發性的例子,請看下幾幅圖:

(1)」not「門(2)」nand「門(3)」nor「門

(1)首先看」not「門吧,a代表輸入(當然只能是1或0),y代表輸出(當然也只能是1或0)。記得上一節說的pmos那個小泡泡了嗎,就是」非「啊。這裡也一樣通用。當然可以用以下記號表示(定義)y=~a,其中~符號在本系列裡表示「非」運算。

(3)這一組當然就是「not」和「or」的組合了也就是「nor」門咯,利用(2)講的就應該能寫出表示式咯。寫完後參考一些:左邊的圖表示式y=~(a+b),其等同的實現也就是右邊的圖y=~a*~b(譯成漢語就是「非」a「與」「非」b)。

舉了上面這三個例子,大家看出來一些頭緒了沒。看所有例子裡所有門的電路圖,都會有pmos和nmos參與工作,所以這個叫做cmos~就是互補mos嘛,所以cmos不是乙個電晶體而是兩個或兩個以上mos的集合!而一般帶有pmos的在「上面」,nmos在「下面」--所以分別被叫做「上拉網路(pull-upnetwork)」,「下拉網路」(pull-downnetwork)。所謂「上面」就是定義為讓輸出y和高電平(vdd)相連的部分,而「下面」自然就是讓輸出y和低電平vss相連的部分。----------講到這裡,有人可能會發現有問題了:如果上拉是斷路,下拉也是斷路,輸出怎麼辦?反過來上拉和下拉都是開啟,豈不是要短路~~沒錯!第乙個情況就是y會處於不確定狀態,比如你用手碰一碰,靜電的值會決定y,所以這時y的輸出被稱為「浮動z(floatingz)」輸出。而第二種情況就是y無法決定取0和1哪乙個值,而由高電平源源不斷的向y輸入不穩定電壓,從而損失靜電能。那麼這個狀態就被稱為「x」(contentionx)。

好了,這一小部分最重要的是用一張紙,和一支筆寫一寫推一推我提出的小問題。下一小節給出形式化的答案~

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