1)防止三極體受雜訊訊號的影響而產生誤動作，使電晶體截止更可靠!三極體的基極不能出現懸空，當輸入訊號不確定時(如輸入訊號為高阻態時)，加下拉電阻，就能使有效接地。
特別是gpio連線此基極的時候，一般在gpio所在ic剛剛上電初始化的時候，此gpio的內部也處於一種上電狀態，很不穩定，容易產生雜訊，引起誤動作!加此電阻，可消除此影響(如果出現一尖脈衝電平，由於時間比較短，所以這個電壓很容易被電阻拉低;如果高電平的時間比較長，那就不能拉低了，也就是正常高電平時沒有影響)!但是電阻不能過小，影響洩漏電流!(過小則會有較大的電流由電阻流入地)
2)當三極體開關作用時,on和off時間越短越好,為了防止在off時,因電晶體中的殘留電荷引起的時間滯後,在b,e之間加乙個r起到放電作用。高頻，深飽和時特別要注意。(次要)
3 )三極體基級加電阻主要是為了設定乙個偏置電壓，這樣就不會出現訊號的失真(這在輸入訊號有交流時極其重要：如當溫度上公升時，ic將增大，導致ie也會增大，那麼在re上的壓降也增大，而vbe=vb-iere，而vb此時基本上被下拉電阻保持住，所以使vbe減小。當然這個減小對0.7v來說是很小的，是從微觀上去分析的。vbe的減小，使ib減小，結果牽制了ic的增加，從而使ic基本恆定。這也是反饋控制的原理)。
而且同時還是為了防止輸入電流過大，加個電阻可以分一部分電流，這樣就不會讓大電流直接流入三極體而損壞其.至於為了放電，一般是在mos管中才用，三極體這個問題不大.
4)如果三極體不接下拉電阻，就不能設定偏置電壓，這樣會產生輸入訊號的交越失真，並且輸 入電流過大的時候會導致大電流直接流入三極體而導致損壞。三極體我們分析的時候有時候總是認為它的內部是有二極體的效應的，但這樣是錯誤的認識，應該更正.而mos管同樣需要乙個偏制電壓，而下拉電阻可以起到這樣的作用，我們一般稱之為gate偏制.由於mos管內部的三個級是彼此絕緣的，所以自然會有電容效應在，當訊號消失的時候內部的等效電容可以通過下拉電阻進行放電.而且也是必須的，否則會邏輯出錯.
接下拉電阻時還要注意：
1 下拉電阻阻值不能太大，不然會導致流入基級的電流太小.
2 如果是高速開關訊號，盡量在下拉電阻上並連乙個電容以提高高速效能
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q1和r1用作限流，r1上的電流達到一定數值後，q1導通，進而導致q2的基極電平公升高，進而截止，不再向vcc out側提供電流。q3可以認為是總開關。所以r3的作用是電流增大後 抬高q2基極電平吧。q1限流，可以理解為b和e之間有個0.6v的鉗位電壓，最大電流是0.6 r1,然後後面q2應該是在放...