1、需要特別注意抗電磁干擾的系統
（1）微控制器時鐘頻率特別高、匯流排週期特別快的系統。
（2）系統含有大功率、大電流驅動電路，如產生火花的繼電器、大電流開關等。
（3）包含微弱模擬訊號電路及高精度a/d轉換電路的系統。
2、應採取的抗干擾措施
（1）能用低速的就不用高速晶元，將高速晶元用在關鍵地方。
（2）可用串電阻的方法降低控制電路上公升沿/下降沿跳變速率。
（3）盡量為繼電器提供某種形式的阻尼電路。
（4）使用滿足系統要求的最低時鐘頻率。
（5）時鐘產生器盡量靠近使用該時鐘的元器件，石英晶體振盪器外殼應接地。
（6）用地線將時鐘區包圍，盡量縮短時鐘線長度。
（7）mcu無用端要接高電平或者接地，或者定義為輸出端，積體電路上該接電源/接地的引腳都要接電源/接地，不要懸空。
（8）閘電路輸入端閒置不用時不要懸空。閒置不用的運算放大器正輸入端應接地，負輸入端應接輸出端。
（9）pcb應盡量使用45度佈線，而不用90度佈線，以減小高頻訊號對外的發射與耦合。
（10）pcb按頻率和電流開關特性分割槽，雜訊元器件與非雜訊元器件的距離盡可能遠。
（11）單面板和雙面板用單點接電源和單點接地，電源線和地線應盡量粗，在經濟方面能承受的情況下，可以使用多層板以減小電源/地的寄生電感。
（12）時鐘、匯流排及片選訊號遠離i/o線和接外掛程式。
（13）模擬電壓輸入線、參考電壓端應盡量遠離數位電路訊號線，特別是時鐘線。
（14）a/d類器件，數字部分與模擬部分寧可統一也不要交叉。
（15）關鍵的線應盡量粗，並在兩側加上保護地。高速線要短且直。
（16）盡量選用短引腳的器件，去耦電容引腳也盡量短。
（17）對雜訊敏感的線不要與大電流、高速開關線平行。
（18）弱訊號電路、低頻電路周圍不要有電流環路。任何訊號都不要形成環路，若不可避免，應使環路區盡量小。
（19）為每個積體電路新增乙個去耦電容；每個電解電容邊上都要接乙個小的高頻旁路電容。
（20）盡量使用大容量的鉭電容而不用電解電容，作為電路的充放電儲能電容，使用管狀電容時外殼要接地。
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