主鎖相環mpll作為系統時鐘的參考時鐘
輔助鎖相環epll作為特殊的功能塊的參考時鐘
mpll的配置方法
om暫存器配置為0，則時鐘源為xtl，配置為1，則時鐘源為外部時鐘extclk
epll的配置方法
如下圖配置clksrc，clksrc和om暫存器
正常狀況下當改變mpll時，此時會產生一段locktime，在改變pll的這段時間，時鐘不會作被提供給內部的資源
示例配置時鐘regiter產生特定的頻率
eg：pll 輸出頻率為533mhz時， 時鐘
armclk
hclk
pclk
ddrclk
ssmcclk
頻率
533mhz
133mhz
66mhz
266mhz
66mhz
配置暫存器
armdiv
prediv
hclkdiv
pclkdiv
halkhclk
值4'b0000
2'b01
2'b01
1'b1
1'b1
eg:pll輸出頻率為800mhz時，
時鐘
armclk
hclk
pclk
ddrclk
ssmcclk
頻率
400mhz
133mhz
66mhz
266mhz
66mhz
配置暫存器
armdiv
prediv
hclkdiv
pclkdiv
halkhclk
值4'b0001
2'b10
2'b01
1'b1
1'b1
mpll輸出頻率計算公式 （配置mpllcon暫存器）
初始化時鐘clock_init()
1.設定分頻 clkdiv0
2.設定locktime lockcon0
3.設定mpll mpllcon
4.設定時鐘源 clksrc
公式：armclk = mpllout/armclk ratio = mpllout/(armdiv+1) = 800/2 = 400mhz
hclk = mpllout/hclk ratio = mpllout/( (prediv+1) * (hclkdiv + 1) ) = 800/(3*2) = 133mhz
pclk = hclk/pclkdiv = 133/2 = 66mhz
（串列埠的時鐘為pclk）
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