lvds是一種低擺幅差分訊號技術，使用非常低的幅度訊號，通過一對差分pcb連線或者平衡電纜傳輸資料，它可以達到每秒數百兆位元以上的傳輸速率，而且具有很多優點：恆定的驅動電流、低功耗、簡單的pcb板的設計、良好的抗電磁干擾，對於電源、地、外部環境的雜訊的不敏感等。在國際標準ansi/eia一644中，主要定義了lvds的電特性，並建議了655 mbps的最大速率和1．823 gbps的無失真媒質上的理論極限速度；在ieee p1596．3中，主要面向sci(scalable coherent inte***ce)，定義了lvds的電特性，還定義了sci協議中包交換時的編碼。在兩個標準中都指定了與物理媒質無關的特性，這保證了lvds能夠成為多用途的介面標準。
sublvds(如圖1所示)作為lvds的發展，採用低擺幅電流模式傳輸系統，同傳統的電壓模式相比較，在達到幾乎相同的效能水平時，由於有比傳統模式更好的抗電源雜訊能力，它可以在雜訊容限低得多，而且擺幅也低得多的情況下工作。設計乙個高效電流模式電路的主要挑戰是靜態功耗，但這在超高速網路中不成問題，因為這時的動態功耗往往起主要作用。再者，此處採用了更加先進的工藝，將供電電壓從2．5 v降到1．8 v，輸出電壓擺幅從350 mv降為150 mv，從而可以達到更低的功耗和提供更高的傳輸速率。
sublvds驅動電路
驅動電路是sublvds中的重要部分，其功能是實現將輸入的cmos訊號轉換為差分輸出訊號，使得在傳輸過程中，抗噪特性更好。本研究中的驅動電路主要分為2部分：pre．driver和transmitter。
sublvds驅動電路的設計:
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