源終端匹配電阻的分析及EMC相關問題

2021-08-13 12:11:27 字數 1669 閱讀 3490

一般的做法是在訊號源端串小電阻,在訊號終端並乙個小電阻。

在訊號源端串乙個小電阻,沒有公式的理論:一般傳輸線的特徵阻抗為50歐姆左右,而ttl電路輸出電阻大概為13歐姆左右,在源端串乙個33歐姆的電阻,13+33=46大致和50相當,這樣就可以抑制從終端反射回來的訊號 再次反射。(傳輸線的特徵阻抗,得查查...)

訊號接收終端串接電阻,從抑制訊號反射的角度考慮,只有終端輸入的電阻小於50歐姆。但ic設計時,考慮到接收能量,不會將接收端的輸入電阻設計得小.。(這個反射,到底是如何理解?能量反射,有了解的朋友解答一下)

在訊號線上串乙個電阻,可能還有乙個用途:esd

如在usb介面上,靠usb port端 的d+和d-上串乙個小電阻,如10歐姆。就是因為usb port端的esd過不了

一般高速數碼訊號傳輸線上會串電阻,目地是解決阻抗匹配問題,阻抗不匹配會導致訊號反射,電磁波類似光一樣在同一種介質中傳播方向和能量不會衰減,但如果光從一種介質發射到另外一種介質的時候會發生反射和折射現象,那麼光到達終端的能量會衰減很多吧。同理高速數碼訊號從源端向終端傳輸過程中由於連線線或者pcb layout的原因導致部分阻抗不連續(比如要求傳輸線阻抗為100歐,但是pcb有的部分是100歐,但是中途打過孔或者線寬發生變化就會引起阻抗的不連續)就會導致訊號反射,反射的訊號在傳輸線中又會與原訊號疊加,訊號被干擾了,終端接收這樣的訊號解碼會出錯。usb介面上串的電阻就是此用途,一般來說如果layout比較好此電阻貼0歐沒問題的,而且如果usb只是傳輸低速訊號也不會有問題,阻抗要求也沒那麼嚴格。但是如果傳輸的是高速usb訊號且layout有問題那麼串個小電阻可能會解決誤碼的問題。一般的做法是在訊號源端串小電阻,在訊號終端並乙個小電阻。

在訊號源端串乙個小電阻,沒有公式的理論:一般傳輸線的特徵阻抗為50歐姆左右,而ttl電路輸出電阻大概為13歐姆左右,在源端串乙個33歐姆的電阻,13+33=46大致和50相當,這樣就可以抑制從終端反射回來的訊號 再次反射。(傳輸線的特徵阻抗,得查查...)

訊號接收終端串接電阻,從抑制訊號反射的角度考慮,只有終端輸入的電阻小於50歐姆。但ic設計時,考慮到接收能量,不會將接收端的輸入電阻設計得小.。(這個反射,到底是如何理解?能量反射,有了解的朋友解答一下)

在訊號線上串乙個電阻,可能還有乙個用途:esd

如在usb介面上,靠usb port端 的d+和d-上串乙個小電阻,如10歐姆。就是因為usb port端的esd過不了

一般高速數碼訊號傳輸線上會串電阻,目地是解決阻抗匹配問題,阻抗不匹配會導致訊號反射,電磁波類似光一樣在同一種介質中傳播方向和能量不會衰減,但如果光從一種介質發射到另外一種介質的時候會發生反射和折射現象,那麼光到達終端的能量會衰減很多吧。同理高速數碼訊號從源端向終端傳輸過程中由於連線線或者pcb layout的原因導致部分阻抗不連續(比如要求傳輸線阻抗為100歐,但是pcb有的部分是100歐,但是中途打過孔或者線寬發生變化就會引起阻抗的不連續)就會導致訊號反射,反射的訊號在傳輸線中又會與原訊號疊加,訊號被干擾了,終端接收這樣的訊號解碼會出錯。usb介面上串的電阻就是此用途,一般來說如果layout比較好此電阻貼0歐沒問題的,而且如果usb只是傳輸低速訊號也不會有問題,阻抗要求也沒那麼嚴格。但是如果傳輸的是高速usb訊號且layout有問題那麼串個小電阻可能會解決誤碼的問題。

esd器件一般都是通過一定的路徑或者方式將靜電盡可能的匯入地或者電源而避免對晶元的影響,所以esd器件有一端肯定是接地的,而不是串在電路中。

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