FPGA與DSP共享外部匯流排問題

2021-08-22 10:48:35 字數 281 閱讀 3026

不知道為什麼,fpga一燒入晶元之後,dsp訪問外部匯流排就無法正常。估計原因出在fpga的匯流排上,將原本不是給fpga的資料當成自己的了。所以dsp無法正常訪問。

因為我不是搞硬體的,所以遇到這個問題我也無能為力。不過,已經見識了fpga的強大功力了,很想好好接觸一下。但是事情很多,不知道有沒有這個時間學習。

下下週才能上班,要解決這個問題,還能花功夫。fpga還有很多問題,以後的資料傳輸又是一難題。真難為了硬體組的那個新手了。

當然,我對dsp的外部匯流排理解也比較膚淺,利用這難得的假期,好好看一遍。

FPGA與DSP共享外部匯流排問題

不知道為什麼,fpga一燒入晶元之後,dsp訪問外部匯流排就無法正常。估計原因出在fpga的匯流排上,將原本不是給fpga的資料當成自己的了。所以dsp無法正常訪問。因為我不是搞硬體的,所以遇到這個問題我也無能為力。不過,已經見識了fpga的強大功力了,很想好好接觸一下。但是事情很多,不知道有沒有這...

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