要設定pwm模組首先要確定片內匯流排時鐘，mc9s12xs系列微控制器增加了時鐘產生器模組，鎖定內部頻率更高的壓控振盪器vco頻率，作為系統時鐘，微控制器的內部時鐘可達80mhz，片內匯流排時鐘可達40mhz。
先給出一段例程
code:
refdv=0x07;//refdiv=7
synr=0x53;//syndiv=19
while(lock!=1);//等待vco穩定
postdiv=0;//postdiv=0,vco時鐘=80mhz
clksel_pllsel=1;//選擇由fpll產生匯流排時鐘，fbus=fpll/2=40mhz
注：lock之前省去了暫存器名，這裡是遮蔽不給發出來。
下面開始簡單分析一下暫存器
（1）時鐘分頻暫存器（crg reference divider register ，refdv）
refdv
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
reffrq1
reffrq0
refdv5
refdv4
refdv3
refdv2
refdv1
refdv0
復位時: 0
0 00 0
0 00
refdv暫存器的高兩位reffrq[ 1：0 ]表示參考時鐘範圍
reffrq1
reffrq0
參考時鐘範圍 0
01~2mhz（預設） 0
12~6mhz 1
06~12mhz 1
1大於12mhz
refdv的低六位為分頻因子refdv的值，有效值的範圍為0~63.
（2）時鐘合成暫存器（crg synthesizer register , synr）
synr
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
vcofrq1
vcofrq0
synr5
synr4
synr3
synr2
synr1
synr0
復位時 0
0 00 0
0 00
synr高兩位控制壓控振動器vco的增益
vcofrq1
vcofrq0
voc頻率 0
0預設，32~48mhz 0
148~80mhz 1
0 冗餘
1 180~120mhz
synr暫存器的低六位可寫入0~63.可將鎖相環時鐘倍頻1~64倍。
鎖相環產生的時鐘頻率可由下面的公式得到
pllclk=2 * oscclk* ( synr+1 ) / ( refdv+1 )
（3）鎖相環暫存器（pll control register , pllctl）
pllctl
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
cme
pllon
fm1fm0
pstwkp
prepce
scme
復位時: 1
1 00 0
0 01
cme：時鐘監控允許位。
pllon：鎖相環電路允許位。
fm [ 1 : 0 ]：選擇附加調頻濾波器以降低vco雜訊，預設值表示不使用該濾波器，可寫入01,10或11，表示參考頻率相對於vco偏高1%,2%,4%時自動調整。
fstwkp：時鐘快速喚醒cpu功能位。
pre：cpu偽停止狀態時，實時中斷（rt1）允許位。
pce：cpu虛擬停止時，看門狗（cop）允許位。
scem：自時鐘方式允許位，預設為1，探測到外部晶振停振時進入自時鐘模式，為0時，禁止自時鐘模式，探測到外部晶振停振時復位。
（4）時鐘產生標誌暫存器（crg flag register ）
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
rtif
porf
lvrf
lockif
lock
ilaf
scmif
scm復位時: 0
0 00 0
0 00
lock：鎖相環頻率鎖定標誌，為1表示時鐘頻率已穩定，鎖相環頻率已鎖定。
（5）時鐘選擇暫存器（clock select register , clksel）
clksel
bit7
bit6
bit5
bit4
bit3
bit2
bit1
bit0
pllsel
pstf
syswa
roawa
pllwai
cwartiwa
copwa
復位時: 0
0 00 0
0 00
pllsel：選定鎖相環（pll select）位，置1為選定鎖相環時鐘。
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