testbench的檔案讀寫

reg [7:0] data_mem[0:255]; //定義乙個8bit x 256的陣列

initial
begin
$readmemh("sin.txt",data_mem); //將sin.txt中的資料讀入儲存器data_mem
end

data_mem

作為你的測試資料了。例如可以通過以下**，將

data_mem

的資料送給

data_out：

always @(posedge clk)

begin
if(rst)
begin
data_out <= 8'd0;
i <= 8'd0;
endelse
begin
data_out <= data_mem[i]; //將儲存器中的資料輸出
i <= i + 8'd1;
endend

verilog

語句實現將訊號

data_out

的資料寫入

data_out.txt檔案

integer w_file;

initial w_file = $fopen("data_out.txt");
always @(i)
begin
$fdisplay(w_file,"%h",data_out);
if(i == 8'd255) //共寫入256個資料
$stop;
end

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