本文收錄在《lte教程：原理與實現（第3版）》第1章擴充套件閱讀
之所以會產生這個問題，是因為最近在研究基帶晶元，比如驍龍以及麒麟，對其峰值速率的來由很感興趣。
仔細研究了一下，發現還不簡單。主要的原因是lte-a的峰值速率比lte複雜，與聚合的載波數量、每個成員載波的層數、調製方式等條件相關。而基帶晶元的資料並沒有完整提供以上這些資訊，通常只給出了峰值速率，需要我們去拼湊出條件。
其中，anandtech**提供了麒麟遠比官方**詳盡的引數，而sharetechnote**給出了峰值速率的計算方法。
附帶講一句，sharetechnote對lte系統的分析和介紹極為詳盡，是不可多得的學習寶庫。讀懂通訊與之相比，差距很大，還要不斷努力。
計算lte-a的峰值速率基於ts36.306的4.1節，但是lte-a的終端型別比lte終端型別複雜，主要是在ts36.306中只規定了最高速率，並沒有規定聚合的載波數量。
另外，lte-a的調製方式有很多種，mimo也有很多種，這樣的組合就很多。
因此，一開始計算峰值速率時，有些迷糊。直到後來看到了sharetechnote下面這篇文章：
throughput calculation - from ue cateogory
從這篇文章可以看出，計算峰值速率需要去湊，自己去設計調製方式、mimo以及聚合的載波數量。
根據這樣的思路，接下來計算驍龍以及麒麟的峰值速率。
首先看高通的驍龍，官方提供的資訊比較豐富，計算起來比較方便。
x5：cat.4，2*2mimo、64qam，下行峰值速率150mbps（精確速率為150.752 mbps）
x7：cat.6，2*2mimo、64qam、2載波聚合，下行峰值速率300mbps（精確速率為301.504 mbps）
x12：cat.12，2*2mimo、256qam、3載波聚合，下行峰值速率600mbps（精確速率為587.376 mbps）
值得注意的是，如果是2*2mimo、64qam、4載波聚合，那麼下行峰值速率才是600mbps（精確速率為603.008 mbps）
x16：cat.16，2*2mimo、256qam，3載波聚合以及4*4mimo、256qam，下行峰值速率1gbps（精確速率為979.008 mbps）
x18：cat.18，2*2mimo、256qam，4載波聚合以及4*4mimo、256qam，下行峰值速率1.2gbps（精確速率為1174.8 mbps）
x20：cat.20，2*2mimo、256qam、4載波聚合以及4*4mimo、256qam、載波聚合,下行峰值速率2gbps（精確速率為1958.064 mbps）
910：cat.4，2*2mimo、64qam，下行峰值速率150mbps（精確速率為150.752 mbps）
920/930/950：cat.6，2*2mimo、64qam、2載波聚合，下行峰值速率300mbps（精確速率為301.504 mbps）
960：cat.12，2*2mimo、64qam、4載波聚合，下行峰值速率600mbps（精確速率為603.008 mbps）
970：cat.18，2*2mimo、256qam、5載波聚合，下行峰值速率1gbps（精確速率為978.96 mbps）
附帶說一下，華為提供的資料是1.2gbps，但是從給出的條件湊不出這個速率。
980：cat.21，4*4mimo、256qam、3載波聚合，下行峰值速率1.2gbps（精確速率為1211.616 mbps）
附帶說一下，華為提供的資料是1.4gbps，但是從給出的條件湊不出這個速率。
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