ddr sdram和sdr sdram的主要區別為（1）時鐘的差分對線（2）電平標準為sstl_25，（3）增加了隨路時鐘dqs。
dqs的增加主要因為ddr速度的提高，使得時鐘訊號和資料訊號的對齊越來越難。在sdram中，clk和dq是中心線對齊原則，在速度提高之後，這種對齊因為各種原因（pcb線的延時，電磁相容）越來越難做到，因此加了一路隨路時鐘dqs，dqs在走線時和dq遇到的環境是一樣的，因此系統可以根據dq的邊沿來知道如何對齊。
在cpu從sdram中讀資料時，資料的方向是從sdram到cpu，sdram作為驅動器，將dqs與dq邊沿對齊，
在cpu向sdram中寫資料時，資料的方向是從cpu到sdram，cpu作為驅動器，將dqs與dq中心線對齊.
ddr2在ddr的基礎上增加了odt，電平標準變成了sstl_18。
odt的解釋，內部的匹配電阻，沒有這個的話，出於阻抗匹配的考慮，需要在終端併聯上匹配電阻，現在這些直接做到晶元內部去了，就叫odt，在fpga中叫做oct。
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RandomStringUtils生成隨機數
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