桌球操作的寫入控制器

2021-09-10 13:30:40 字數 2385 閱讀 9326

桌球操作的寫入控制器,由wr_en使能,使能後,將會根據記憶體寫入次數的計數,輸出合適的位址,記憶體塊的片選訊號,以及將資料來源的資料輸出,由於wr_req要求先資料乙個時鐘,這樣,如果使能模組判斷可以寫入,則wr_en和data_in同時進入此模組,乙個時鐘後,輸出位址,資料,片選

從而完成資料的寫入。[3:0]wea為bram的位數有效訊號:位址一般指均是1b(8位資料)的位址,所以對於32位輸入,位址每次要加4,且用四位[3:0]wea告知bram寫入哪些八位,全1則四個8位都寫入,0010意味著寫入第二個八位。

`timescale 1ns / 1ps

//// company:

// engineer:

//// create date: 2018/09/14 22:30:46

// design name:

// module name: wt2bram_ctl

// project name:

// target devices:

// tool versions:

// description:

// 桌球操作的寫入控制器,由wr_en使能,使能後,將會根據記憶體寫入次數的計數,輸出合適的位址,記憶體塊的片選訊號,以及將資料來源的

//資料輸出,由於wr_req要求先資料乙個時鐘,這樣,如果使能模組判斷可以寫入,則wr_en和data_in同時進入此模組,乙個時鐘後,輸出位址,資料,片選

//從而完成資料的寫入。[3:0]wea為bram的位數有效訊號:位址一般指均是1b(8位資料)的位址,所以對於32位輸入,位址每次要加4,且用四位[3:0]wea

//告知bram寫入哪些八位,全1則四個8位都寫入,0010意味著寫入第二個八位。

// dependencies:

//// revision:

// revision 0.01 - file created

// additional comments:

//module wt2bram_ctl(reset,clk,wr_en,data_in,data_out,addra,bram_time,bram_en1,bram_en2,wea,state

);input clk;

input reset;

input wr_en;

input [31:0]data_in;

output[13:0] bram_time;

output bram_en1;

output bram_en2;

output [3:0]wea;

output [31:0]data_out;

output [31:0]addra;

output state;

reg [13:0]bram_time;

reg bram_en1;

reg bram_en2;

reg [3:0]wea;

reg [31:0]addra;

reg [31:0]data_out;

reg [12:0]count;

always @(posedge clk or negedge reset)

if(!reset)

begin

count <= 13'b0;

addra <= 32'b0;

data_out <= 32'b0;

bram_time <= 14'b0;

wea <= 4'b0000;

bram_en1 <= 1'b0;

bram_en2 <= 1'b0;    

endelse if(wr_en)

begin

count <= count + 1;

if(count == 0)

addra <=0;

else

addra <= addra + 4;

data_out <= data_in;

wea <= 4'b1111;

if(count == 8191)

bram_time <= bram_time + 1;

else

bram_time <= bram_time;

bram_en1 <= ~bram_time[0];

bram_en2 <= bram_time[0];

endelse

begin

count <= count;

addra <= addra;

data_out <= data_out;

bram_time <= bram_time;

bram_en1<= 1'b0;

bram_en2<= 1'b0;

wea <= 4'b0000;

endassign state =   bram_time[0];      

endmodule

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