USB Phy ULPI 1 認識引腳

2021-09-12 05:34:00 字數 1237 閱讀 8679

最近除錯st的329板子的usb模組,外接了乙個usb phy,剛好學習了一下這個usb phy 。

smsc的usb334x 提供了 usb2.0高速傳輸的物理層的解決方案. 晶元的結構圖如下:

ovp:過電保護

esd protection:靜電保護

otg: otg 模組

hi-speed usb transeiver:高速usb 傳輸模組

pll: 振盪電路產生時鐘

ulpi registers : ulpi暫存器和狀態機

以及 整合電源管理和ulpi介面

引腳的介紹:

id:接到usb 聯結器,作為該引腳為高時作為device,該引腳為低時作為host

vbus:輸入,5v電壓, 電壓來自於usb 聯結器

dp:輸入輸出,usb聯結器的d+引腳 ,接到usb 聯結器,高速或全速裝置該引腳被拉高,dm被拉低。 反之亦然。

dm:輸入輸出,usb聯結器的d-引腳 ,接到usb 聯結器

reset: reset引腳,接到mcu

vbat: 輸入3.3-5.0v的電壓

clkout:輸出60mhz 的ulpi 時鐘

refclk:輸入60mhz 的ulpi 時鐘

vdd18:輸出1.8v的電壓

vdd33:輸出3.3v的電壓

resetb: 輸入,當拉低的時候vdd18和vdd33不輸出電壓,拉高的時候作為乙個正常的ulpi裝置

data1-data7:輸入輸出,雙向資料線,連線到mcu. mcu通過data1-data7 向phy

stp: 輸入,來自於mcu,當匯流排上有資料傳送時該引腳被拉低,當匯流排上最後乙個資料傳送結束時被重新拉高

dir:輸出,輸出到mcu,控制資料的傳輸方向,當有資料從phy輸入到link(mcu)時,引腳被拉高。 沒有資料的時候或者mcu有資料傳到phy時,被拉低。同時監聽匯流排上來自link的命令

nxt: 輸出,控制資料傳輸,表示當前的資料phy端已經接收到了。

檢測:1.上電之後檢測,vdd33、vdd18有輸出,clkout有輸出

2.判斷高速低速裝置,檢測 dp、dm的電壓

3.判斷host、device,檢測 id的引腳電壓

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