上一期中我們介紹了arm64體系的異常，這一期我們將介紹arm64體系中通用中斷控制器（general interrupt controller，gic）的中斷處理流程。
中斷是外設給處理器傳遞資訊的一種方式，外設中斷相對於處理器通常是非同步的。arm64體系中外設中斷是通過通用中斷控制器**給處理器的。通用中斷控制器是支援和管理中斷的硬體部件，它提供了用於管理中斷源、中斷行為和將中斷路由至乙個或多個處理器的暫存器。gicv3（general interrupt controller version 3）支援armv8-a 架構，其硬體架構定義了：
對於每乙個處理器，gic描述了系統內的不同中斷是如何產生外部中斷請求（irq）和快速中斷請求（fiq）的，而armv8-a異常模型（exception model）則描述了處理器是如何處理這些irq和fiq中斷請求的。
gic用於處理外設中斷，外設中斷表現為傳送給gic的訊號。gic定義了四種外設中斷：
gicv3的硬體架構圖如下圖所示[1]：
可以看出gicv3由distributor、redistributor、cpu inte***ce和its四個部分組成，它們的功能是：
redistributor：為ppi提供配置，將處於pending狀態的最高優先順序的中斷在有限時間內傳送給cpu介面；
cpu inte***ce：cpu inte***ce提供乙個連線處理器（processing element，pe）與gic的介面；
its（interrupt translation service）：將事件轉化為lpi（可選的）。
gic處理物理中斷的流程如下圖所示[1]：
各個階段的含義為：
本期我們考察了armv8-a架構中gic（general interrupt controller）的中斷處理流程，下一期我們將介紹linux核心中的中斷處理流程。
參考文獻
[1] arm® generic interrupt controller architecture specification gic architecture version 3.0 and version 4.0 beta
[2]
[3]
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