實驗報告二 例2 19 一位全加器

2021-10-06 19:32:19 字數 2113 閱讀 3196

廣工計算機組成原理實驗

實驗二要求:

例2-19一位全加器,要做出**波形

提交完整詳細的**,元件圖,測試波形,說明文字

學習、掌握quartusii開發平台的基本使用

設計乙個一位全加器,並驗證全加器的功能

乙個一位全加器可以用兩個一位半加器和乙個或門連線而成。而乙個一位半加器可由基本閘電路組成。

半加器設計原理:只考慮兩個一位二進位制數的相加,而不考慮來自低位進製數的運算電路,稱為半加器。

其中:a、b分別為被加數與加數,作為電路的輸入端;s0為兩數相加產生的本位和,它和兩數相加產生的向高位的進製c0一起作為電路的輸出。

全加器設計原理:除本位兩個數相加之外,還要加上從低位來的進製數,稱為全加器。

其中:a為被加數,b為加數,c為低位向本位的進製,c0為本位向高位的進製,s0為本位和。

利用vhdl編輯程式實現半加器和或門,再連線半加器和或門完成全加器的設計。

通過這次實驗,學習且掌握了quartusii開發平台的基本使用。

能設計出乙個一位全加器,並驗證全加器的功能。

學會了使用元件例化語句。例化語句用於層次設計,即在當前設計中呼叫乙個已經設計好的功能模組。

component 元件名 is 

port (埠名錶) ;

end component 檔名 ;

例化名 : 元件名 port map( [埠名 =>] 連線埠名,…);

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