目錄
1.s3c2440的時鐘體系
1.1.s3c2440結構框圖
1.2 s3c2440時鐘樹
1.3 s3c2440上電順序
2.暫存器配置
2.1clkdivn暫存器
2.2mpllcon暫存器
2.3設定cpu為非同步模式
3.程式設計
4.實驗
從上面的結構圖可以看出，s3c2440主要分為cpu，高速匯流排，低速匯流排。其中
cpu工作與fclk
ahb匯流排工作於hclk，ahb(advance high performance bus)匯流排主要用於高效能模組。
慢速外設工作於pclk，apb(advance peripheral bus)匯流排主要用於低貸款的周邊外設之間的連線。
我們的s3c2440硬體電路板上，時鐘源是乙個12m的晶振，我們用pll鎖相環可以得到上面的三種頻率。
從上圖的左上角可以看出，時鐘源有兩個選擇，可以是晶振，也可以是直接從extclk管腳輸入的時鐘。具體選擇什麼時鐘源由後面的om進行選擇，我們的電路圖中om的兩個管腳都是接地低電平的，因此使用晶振作為時鐘源。
然後往後有兩個pll，mpll和upll，分別是main pll和usb pll.
晶振經過mpll，得到fclk提供給cpu，然後fclk經過hdiv分頻可以得到hclk提供給ahb匯流排，經過pdiv得到pclk提供給apb匯流排。
晶振經過upll然後給usb提供時鐘。
下面我們程式設計來配置s3c2440的時鐘，我們配置fclk=400m，hclk=100m, pclk=50m。我們需要設定mpllcon暫存器讓fclk=400m.然後設定clkdivn讓hclk=fclk/4, pclk=fclk/8.
我們把clkdivn[2:1]的hdivn設定為10，然後clkdivn[0]的pdivn設定為1.
我們通過設定mdiv=92，pdiv=1,sdiv=1就可以設定fclk=400m.
另外，晶元手冊裡面有乙個注意事項，如果我們的hdivn不是零的話，cpu匯流排必須設定為非同步模式，否則cpu會使用hclk而不是fclk.所以我們要設定cpu為非同步模式。
修改之前的start.s.
.text
.global _start
_start:
/* 關閉看門狗 */
ldr r0, =0x53000000
ldr r1, =0
str r1, [r0]
/* 設定mpll, fclk : hclk : pclk = 400m : 100m : 50m */
/* locktime(0x4c000000) = 0xffffffff */
ldr r0, =0x4c000000
ldr r1, =0xffffffff
str r1, [r0]
/* clkdivn(0x4c000014) = 0x5, tfclk:thclk:tpclk = 1:4:8 */
ldr r0, =0x4c000014
ldr r1, =0x5
str r1, [r0]
/* 設定cpu工作於非同步模式 */
mrc p15,0,r0,c1,c0,0
orr r0,r0,#0xc0000000 //r1_nf:or:r1_ia
mcr p15,0,r0,c1,c0,0
/* 設定mpllcon(0x4c000004) = (92<<12)|(1<<4)|(1<<0)
* m = mdiv+8 = 92+8=100
* p = pdiv+2 = 1+2 = 3
* s = sdiv = 1
* fclk = 2*m*fin/(p*2^s) = 2*100*12/(3*2^1)=400m
*/ldr r0, =0x4c000004
ldr r1, =(92<<12)|(1<<4)|(1<<0)
str r1, [r0]
/* 一旦設定pll, 就會鎖定lock time直到pll輸出穩定
* 然後cpu工作於新的頻率fclk
*/
/* 設定記憶體: sp 棧 */
/* 分辨是nor/nand啟動
* 寫0到0位址, 再讀出來
* 如果得到0, 表示0位址上的內容被修改了, 它對應ram, 這就是nand啟動
* 否則就是nor啟動
*/mov r1, #0
ldr r0, [r1] /* 讀出原來的值備份 */
str r1, [r1] /* 0->[0] */
ldr r2, [r1] /* r2=[0] */
cmp r1, r2 /* r1==r2? 如果相等表示是nand啟動 */
ldr sp, =0x40000000+4096 /* 先假設是nor啟動 */
moveq sp, #4096 /* nand啟動 */
streq r0, [r1] /* 恢復原來的值 */
bl main
halt:
b halt
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