Makefile檔案格式

make的工作主要依賴於乙個叫makefile的檔案。makefile檔案描述了整個程式的編譯、鏈結等規則。

targets : prerequisites

command

targets：目標

prerequisites：依賴

command：命令，命令需要使用[tab]鍵空格

例：

led.elf : led.o

arm-linux-ld -tled.lds -o led.elf led.o

makefile把那些只包含命令，沒有任何依賴的目標稱為「偽目標」.

.phony : clean

clean :
rm -f hello main.o func.o

make led.o //在makefile查詢目標為led.o的規則並執行。

make //預設執行第一條規則，第一條規則的依賴檔案找不到的話，自動執行目標檔案為第一條規則的依賴檔案的規則。

使用者自定義的變數

使用變數前：

使用變數後：

obj=func1.o func2.o

$^：代表所有的依賴檔案
$@：代表目標
$<：代表第乙個依賴檔案
使用前：
led.o : led.s
arm-linux-gcc -g -o led.o -c led.s

使用後：

led.o : led.s

arm-linux-gcc -g -o $@ -c $^

%.o //表示所有以.o結尾的檔案

%.c //表示所有以.c結尾的檔案

%.s //表示所有以.s結尾的檔案

注釋：「#注釋內容」

去回顯：命令前加「@」

section

. = aling(4) 　　　　#
設定4位元組對齊
.data: 　　　　　　#
資料段 . = aling(4) 　　　　#
設定4位元組對齊
bss_start = .; 　　#
定義變數=當前位置位址
.bss: 　　　　　　#
bss段
bss_end = .; 定義變數=當前位置位址
}

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