陣列和延時在fpga中使用

2021-07-16 08:31:18 字數 795 閱讀 6948

關於陣列在fpga中的使用方式

//verilog陣列

integer number [0:100]; //宣告乙個有 101 個元素的整數陣列

number [25] = 1234; //將 1234 賦值給 25 號(第 26 個)元素

reg [7:0] my_input [65535:0]; //宣告乙個有 65536 個元素的 8 位向量暫存器

my_input [97] = 8'b10110101; //將 10110101 分別賦值給 97 號(第 2 個)元素的 7 至 0 位

reg my_reg [0:3][0:4]; //宣告乙個具有 20 個元素的二維暫存器陣列

my_reg [1][2] = 1'b1; //將 1 賦值給上述二維陣列的第 2 行、第 3 列元素

關於延時在fpga中的使用方式

//常規延遲和內嵌延遲:

parameter latency = 8;

initial begin

x = 1;

y = 2;

#5 x = 3; //使用常規延遲:等待 5 個系統週期後對 x 賦值

#latency y = 4; //使用變數進行常規延遲,再等待 8 個系統週期後對 y 賦值

z = #10 (x+y); //使用內嵌延遲:先用當前時刻的 x、 y 數值計算(x+y),再等待10 個系統週期後對 z 賦值

end//z 的最終數值為 7

在DP中使用 滾動陣列

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在NumPy中使用動態陣列

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