那些年在vivado上踩到的坑

2021-09-26 02:50:54 字數 642 閱讀 5606

1.如果在vivado裡面的乙個工程,呼叫了兩個不同的 自定義ip(舉例模組a和b) ,但這兩個ip分別呼叫了 同乙個 子**(舉例 test.v),則需要注意如下問題:如果在 a 和 b 裡面, 這兩個test.v 完全一致的話,那編譯的時候不存在問題,也不會報 critical waring ;如果不巧,a b 模組都沒想到對方模組會和自己有乙個同樣名字的子**,兩個模組下這個子**的功能還不一樣,那在編譯時,後面編譯的模組的 test.v會將前面編譯完成的模組的test.v檔案覆蓋掉,並報critical waring 。

2.關於位寬的定義問題。之前在乙個ram管理模組的**中,將位寬(通過上層paramater引數傳遞)定義的都剛剛好不多不少,使用modelsim 和 vivado2018.2的自帶**時,結果都正確。但是上板測試時,發現工具將cnt綜合成有符號數,相當於致使位寬少了乙個bit,後面解決的方法是,將通過引數傳遞的位寬加多乙個bit。暫未弄清楚出現這個問題的原因是什麼(可能是編譯策略的問題???目前不清楚)。

3.在進行邏輯設計時,不是在top層的 io port ,盡量不要使用 inout定義。原因是,如果定義普通的內部使用的輸入輸出訊號,使用了inout定義的話,那工具在布局佈線的時候,會將這個訊號布局到晶元邊緣的 io port 上 ,因為只有在 io bank **才有 inout 的資源。

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