makefile工程管理
makefile檔案描述了整個工程的編譯，連線等規則
規則如何生成乙個或多個目標檔案
targets(目標):prerequisites(依賴)
command(路徑)
示例**:
test34:test34.o test33.o test31.o
(tab) gcc$~ -o $@
第一條語句為最終目標
make -f 指定makefile檔名
偽目標.phony:clean #將clean目標宣告為偽目標
clean:
rm -f $@.$$$$
變數示例**如下：
obj=main.o func1.o func2.o func3.o
hello:$(obj)
gcc$(obj) -o hello
系統預設的自動化變數
$^ 所有依賴檔案
$@ 代表目標
$< 代表第乙個依賴檔案
注釋#後新增注釋內容
命令前新增@可以取消回顯
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