觸發器是時序邏輯電路的基本單元，用來儲存1位2進製資訊，具有記憶和儲存功能，其資訊由雙穩態電路來儲存。觸發器位脈衝邊緣敏感器間，分為上公升沿敏感和下降沿敏感。觸發器的種類很多，由d觸發器，j-k觸發器，t觸發器等。並且根據運用場景的不同，觸發器還會有置位，復位，使能和選擇等功能。
d觸發器是一種最簡單的觸發器，在觸發邊沿到來時，將輸入端的值存入其中，並且這個值與當前儲存的值無關。在兩個有效的脈衝邊沿之間，d的跳轉不會影響觸發器儲存的值，但是在脈衝邊沿到來之前，輸入端d必須有足夠的建立時間，保證訊號穩定。d觸發器的邏輯符號如圖1-1所示。
圖1-1
觸發器主要有兩種電路結構，cmos邏輯門如圖2-1，和傳輸門構成的d觸發器如圖2-2
圖2-1cmos邏輯門構成d觸發器
圖2-2，傳輸門構成d觸發器
兩種電路結構實現的d觸發器功能一模一樣，我們以圖2-1為例來分析觸發工作原理。如圖2-1所示：在clk上公升沿到來之前，d輸入端無論輸入任何值觸發器狀態不會改變，次態等於現態。當時鐘上公升沿到來時，與時鐘訊號連線的非門產生的短暫延遲，使得觸發器狀態置成d輸入端的狀態。
d觸發器特性表
1位d觸發器
module dff
(clk,clr,rst,d,q)
;//clr清0，rst復位
input clk,clr,rst,d;
output q;
reg q;
always@(posedge clk or posedge clr)
begin
if(clr==
1'b1)q<=1'b0;
else
if(rst==
1'b1)q<=1'b1;
else q<=d;
endendmodule
module dff_t;
reg clk,rst,clr,d;
wire q;
initial
begin
clk=
1'b0;
forever #10 clk=
~clk;
endinitial
begin
clr=
1'b0;
rst=
1'b0; d=1'b0;
#10 rst=
1'b1;clr=1'b0;d=
1'b0;
#10 rst=
1'b1;clr=1'b1;d=
1'b1;
#10 rst=
1'b0;clr=1'b0;d=
1'b1;
#20 d=
1'b0;
#20 d=
1'b1;
enddff u1(.
clk(clk),.
clr(clr),.
rst(rst),.
d(d),.
q(q));
endmodule
觸發器 mysql觸發器
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