關於MIPI測試

2021-10-04 23:14:34 字數 2001 閱讀 1457

一,mipi協議相關簡介

1,mipi協議和聯盟

mipi協議,即移動產業處理器介面(mobile industry processor inte***ce 簡稱mipi)。mipi是由諾基亞、arm、意法半導體、德州儀器、英特爾、飛思卡爾等廠商聯盟發起的為移動應用處理器制定的開放標準和乙個規範。

隨著客戶要求手機攝像頭畫素越來越高同時要求高的傳輸速度傳統的並口傳輸越來越受到挑戰。提高並口傳輸的輸出時鐘是乙個辦法但會導致系統的emc設計變得越來困難,增加傳輸線的位數是但是這又不符合小型化的趨勢。採用mipi介面的模組相較於並口具有速度快、傳輸資料量大、功耗低、抗干擾好的優點越來越受到客戶的青睞並在迅速增長。

2,mipi協議的主要應用領域

2.5g、3g手機、pda、pmp、手持多**裝置

3,目前應用最為成熟的兩個介面

csi(camera serial inte***ce)乙個位於處理器和顯示模組之間的高速序列介面

dsi(display serial inte***ce)乙個位於處理器和攝像模組之間的高速序列介面。

二,mipi d-phy測試

1,mipi d-phy物理層測試需要準備如下配置:

(1)4g頻寬示波器;

(2)mipi d-phy訊號測試軟體;

(3)復雜訊號分離軟體;

(4)mipi d-phy 觸發和解碼軟體;

(5)4個4ghz以上差分探頭;

(6)d-phy測試夾具

2,mipi d-phy測試專案

(1)data lane hs-tx differential voltages

(2)data lane hs-tx differential voltage mismatch

(3)data lane hs-tx single-ended output high voltages

(4)data lane hs-tx static common-mode voltages

(5)data lane hs-tx static common-mode voltage mismatch δv_cmtx(1,0)

(6)data lane hs-tx dynamic common-level variations between 50-450 mhz

(7)1.3.10 data lane hs-tx dynamic common-level variations above 450 mhz

(8)data lane hs-tx 20%-80% rise time

(9)data lane hs-tx 80%-20% fall time

(10)data lane hs entry: t_lpx value

(11)data lane hs entry: t_hs-prepare value

(12)data lane hs entry: t_hs-prepare + t_hs-zero value

(13)data lane hs exit: t_hs-trail value

(14)data lane hs exit: 30%-85% post-eot rise time t_reot

(15)data lane hs exit: t_eot value

(16) data lane hs exit: t_hs-exit value

(17)hs entry: t_clk-pre value

(18)hs exit: t_clk-post value

(19)hs clock rising edge alignment to first payload bit

(20)data-to-clock skew (t_skew[tx])

(21)clock lane hs clock instantaneous: ui_inst value

(22)clock lane hs clock delta ui: (δui) value

三,mipi協議層測試

mipi測試主要採用邏輯分析儀對協議層資料進行測試,確保傳輸資料報沒有問題。

mipi兩線介面 MIPI介面

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