關於恩智浦MCS9SXEP100晶元時鐘配置的問題

2021-10-10 08:00:53 字數 2090 閱讀 8529

起因:最近工作上用到了恩智浦的mc9sxep100晶元,在對其使用過程中對時鐘模組配置和除錯看門狗晶元sgm760時遇到的一些問題進行記錄和交流,方便大家一起**。

剛拿到mc9sxep100開發板檢視資料手冊時,就感到這款晶元除錯起來會很麻煩,相較於其他晶元的庫函式版程式,xep100全部需要對暫存器進行操作。無形中增加了很多除錯難度,和學習成本。

關於xep100的時鐘配置主要有9個暫存器,其中我們主要需要配置的是3個暫存器,

其中vcofrq[0:1]作用是確定vcoclk的頻率範圍。

而我們最終想要的busclock是通過pllclock得到的

(後面有詳細的解釋)

syndiv[5:0]——鎖相環的倍頻係數

reffrq[1:0]—參考時鐘頻率選擇

這兩位用來配置內部鎖相環的濾波器,以達到最佳的穩定性和鎖定時間。這兩位的選取要根據實際的參考時鐘refclk的頻率確定,refclk時鐘的頻率可以通過下式進行計算:

postdiv[4:0](post分頻器暫存器)

postdiv暫存器控制vcoclk與pllclk之間的分頻係數。pllclk時鐘的頻率如下式計算

如果postdiv=0,則fpll=fvco

假如現在的外部晶振是8mhz,我們想配置乙個32mhz的busclock

由busclock為32mhz可知pll時鐘為64mhz

若配置postdiv為0

則fvco為64mhz

由圖可知:

syndiv+1)/(refdiv+1)=4

則可以配置refdiv為1,syndiv為7

由這個公式可知fref為4mhz

查表可知reffrq[1:0]需要配置為01

總結一下:

synr為0x07

refdv為0x11

postdiv=0

程式演示

void

setbusclock

(void

)

不難看出**中需要先禁止pll輸出到系統,然後再開啟pll進行配置,配置完成後等待時鐘穩定後就可以輸出到系統

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