此設計的結構包括：1.移位暫存器鏈，n階的有n-1個暫存器。
2.第一次累加部分。由fir濾波係數對稱可得到對稱的暫存器相加可以減小電路規模，所以第一次累加很有必要。
3，鎖存並移位部分。此部分是為了通過移出lut位址，通過給出lut位址即可得到lut輸出。
4，lut部分，該部分實現的主要功能是輸出不同位址情況下的結果。
5，二次累加部分。該部分是將每一位卷積得到的結果加權累加，需要注意的是，由於是採用補碼運算，最高位加權後應該是被減去而不是被加上。
分布式濾波器的原理如下
查詢表的實現可參考下表
實現過程的幾個關鍵問題：
這次設計就在加法器頻寬處產生問題，頻寬不夠，發現出來的波形頂部挪到低下去了，通過看中間資料發現是資料位寬不夠造成的，根據這個公式得到的加法器頻寬剛好能滿足設計需求。
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