VHDL 單脈衝的產生

2021-08-20 10:31:15 字數 505 閱讀 6843

在做fpga設計時,中我們經常會遇到需要經乙個高電平訊號轉化成乙個帶脈衝訊號。比如復位訊號進來是乙個很長的高電平訊號,但是復位訊號又必須做成乙個帶脈衝訊號,因此掌握將乙個高電平訊號轉化成單週期的脈衝訊號很有必要。下面就轉化原理進行分析:

先上圖,看圖好說話:

訊號1是原始輸入訊號;

訊號3是訊號1經過乙個週期的延遲得到的訊號;

訊號2是訊號3取反得到的訊號;

訊號4是訊號1延遲兩個週期得到的訊號;

訊號5是最終的單脈衝輸出;

下面來敘述一下這個過程。假設高電平訊號是訊號1,其經過1個週期的延遲得到訊號3,然後再將訊號3取反的到訊號2。同理,訊號1經過2個週期的延遲就得到訊號4;此時訊號1、2、3、4的波形如上圖所示。然後再將訊號2和訊號4相與就得到訊號5,訊號5就是我們要的單脈衝訊號。

最近在著急做實驗,vhdl程式有空再補上來。

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