使用DCDC降壓電路 JW5033晶元

2021-10-13 15:58:05 字數 1382 閱讀 2142

最近在做一款玩具級別的電機控制器,由於使用3s電池(12v),給微控制器和電機進行供電,考慮到轉換效率與散熱,加上之前有過使用lm2950進行12v轉5v對微控制器進行供電時,導致嚴重發熱的慘痛經歷(12v下還給電調供電)。故選擇放棄ldo方案,選擇dcdc方案。

首先我們需要了解dcdc穩壓的大致原理——buck電路

該電路在電路電子書上曾學習過,簡單來說,即通過控制q1導通,實現對buck電路的供電,利用電感及電容的性質,實現對輸出電壓的調節,進而實現穩壓的功能。

當q1導通時,l1被充磁,圖1中的c1充能,同時給負載r1供能。

當q1被關斷後,電感l1為了維持整個電路的電流,會將儲存的磁場轉換為電流進行釋放,通過續流二極體d1,實現電路閉環,同時圖1中的c1也會在此時進行放電

由下圖可以得知,只要控制q1得當,就可以控制電感的儲能和放能,進而控制電感輸出電壓。

根據jw5033t的datasheet,可以得到如下圖1所提供得典型應用電路,其中r3和r2為分壓取樣電阻,由該兩個電阻決定輸出電壓,計算公式如下圖2所示

而在實際應用中,由於發現dcdc的輸出波形存在一定的「噪音」(見下圖4),故將20pf電容併聯在r16取樣電阻電路中,實驗表明,其能有效抑制噪音的產生(見下圖5)。具體原因留坑。

未併入20pf電容前輸出的波形(ch2)

併入20pf電容後所輸出的波形。

在pcb設計中,dcdc的布局應盡可能遵循以下的規則,以此降低紋波干擾。

1、電感需要盡可能靠近晶元(sw)管腳,走線盡量加粗

2、取樣電阻應放置在濾波電容後,這樣有助於減小紋波,且與晶元的走線應盡量短。

1、jw5033晶元datasheet

2、美思迪賽半導體——buck電路工作原理詳解

阻容降壓電路

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