FPGA 驅動舵機

2021-07-23 15:11:34 字數 457 閱讀 7876

牽扯到兩個知識點。

io 口的驅動力;

pwm知識 ;

板子上 的rst 預設時為高電平 ,只有 按下 後 才為 低電平 。

現在那個 uart 模組 測試 沒問題 。

那個 lcd 模組 測試也沒問題 ,

有問題的 是 那個 rst_gen 與 clk 產生 模組 。

感覺又是乙個坑人 的 傢伙

移植了 4個小時 後終於成功

器件:

ee-a7

編譯環境:xilink vivaado 2015.4

原始碼 稍後再放上去

mil 密爾 毫英吋 0.0254mm

英吋 2.54cm

看了那個板子的構圖,我發現真得接個電阻,但是它好像 也沒對pwm管腳公升壓啊,能不能成功呢?我表示很忐忑。今晚跳舞回來除錯一下吧

測試成功!!關鍵點不是電阻,而是共地!!

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