第頁共
頁一、簡答題：
分，每小題
分)1.
cpld
和fpga
有什麼差異？在實際應用中各有什麼特點？
答：差異：
cpld
：複雜可程式設計邏輯器件，
fpga
：現場可變成門陣列；
cpld
：基於乘積項技術的確定
型結構，
fpga
：基於查詢表技術的統計型結構
cpld
5500 ~ 50000
門，fpga
1k ~ 10m
門實際應用中各自的特點：
cpld
適用於邏輯密集型中小規模電路，程式設計資料不丟失，延遲固定，時序穩定；
fpga
適用於資料密集型大規模電路，需用專用的
rom進行資料配置，佈線靈活，但時序特性不穩定
2.簡述
vhdl
語言中埠模式
inout
buffer
和inout
各自的特點及
outbuffer
與inout
的主要區別？
答：埠模式中各自的含義與特點為：
in：輸入，唯讀；
out：輸出，只寫；
buffer
：帶反饋的輸出，可讀可
寫；inout
：雙向，可讀可寫。
outbuffer
inout
各自的區別：
out模式下的訊號，在程式中只能作為物件被賦值，不能作為源賦給其
他訊號；
buffer
模式下的訊號，在程式中既可作為物件被賦值，又可作為源賦給其他訊號，物件和源是同時發
生，是同乙個訊號；
inout
模式下的訊號，雙向傳輸，同樣既做物件又可作源，但物件和源不是同乙個訊號。
3.vhdl
中有哪種資料物件？詳細說明它們的功能特點以及使用場所。
種資料物件為：常量、訊號、變數。
各自的功能特點和使用場所：
常量：代表電路中乙個確定的數，如電源、地等。全域性量，訊號變數使用的地方都可用
訊號：代表電路中的某一條硬體連線線，包括輸入、輸出埠，訊號賦值存在延遲。
全域性量，使用場所：
architecture
package
entitiy
變數：代表電路中暫存某些值的載體。變數賦值不存在延遲。
區域性量，使用場所：
process
function
procedure
4.數字頻率計功能是測量被測訊號的頻率，測量頻率的基本原理是什麼？實現的主要邏輯模組有那些？
答：頻率計測量頻率的基本原理是：
秒時間內代測訊號的脈衝個數
實現頻率計邏輯功能的主要模組有：
時間基準產生電路
：提供秒中的準確計數時間訊號；
計數脈衝形成電路
：將被測訊號變換為可計數的窄脈衝，其輸出受閘門脈衝的控制。
計數顯示電路：
對被測訊號進行計數，顯示被測訊號的頻率
5.vhdl
的基本結構及每部分的基本功能？
答：vhdl
的基本結構由：
庫(library
、程式包(
package
、實體(
entity
、結構體(
architecture
和配置(
configuration
)幾部分組成。
每部分的基本功能為：
庫(library
：用來儲存預先完成的程式包和資料集合體的倉庫。以供設計者對一些統一的語言標準或資料格式進
行呼叫。
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